种类:集成电路(IC) | 品牌:ST | 型号:STM8S003F3P6TR |
南京回收IC芯片
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要测量的输入信号被施加到
输入引脚AINP和AINN。ads1230接受
差分输入信号,也可以测量
单极信号。相对于地测量单极(或单端信号)时,将负输入( AINN )连接到地,并将输入信号连接到正输入( AINP)。请注意
当ads1230以这种方式配置时,仅使用转换器满量程范围的一半,因为仅
产生正数字输出代码。
此数字输出引脚用于两个目的。首先,它通过降低指示何时准备好新数据。然后,在SCLK的***个上升沿,DRDY / DOUT引脚改变功能并开始输出转换数据,有效位( MSB)优先。数据在每个后续SCLK上升沿移出。检索完所有20位后,可以使用额外的SCLK强制引脚为高电平。然后,它会保持高电平,直到新数据准备就绪。当轮询DRDY /DOUT的状态以确定何时开始数据检索时,此配置非常有用。
该数字输入将串行数据随每个上升沿移出。此输入具有内置迟滞,但仍应注意确保信号干净。故障或缓慢上升的信号会导致不必要的额外移位。因此,确保SCLK的上升和下降时间都小于50ns。
ads1230连续地转换模拟输入信号。要检索数据,请等待DRDY /DOUT变为低电平,如图25所示。DRDY /DOUT变为低电平后,通过应用sclk开始移出数据。首先将数据移出MSB。不需要移出所有20位数据,但必须在更新新数据(在tCONV内)之前检索数据,否则数据将被覆盖。避免在更新期间( tUPDATE)检索数据。如果应用了24个sclk,则DRDY / DOUT将为高电平,因为***四个位被附加了“1”。但是,如果仅应用了20个sclk,则DRDY / DOUT将保持在***一个移出位的状态,直到其变为高电平(请参见tUPDATE),表示正在更新新数据。为了避免DRDY / DOUT保持在***一位的状态,可以应用第21个SCLK来强制DRDY /DOUT为高电平, 。当控制设备的主机轮询DRDY /DOUT以确定数据何时准备好时,此技术非常有用。